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[Embeded-SCM Develop] Interleave

Description: 在Maxplus软件平台开发的，使用原理图开发的fpga的纠错编码和交织以及解纠错和解交织的源码文件
Platform: | Size: 4150635 | Author: 熊浩 | Hits:

[Other resource] 8

Description: CPLD/FPGA实用手册，新手最爱，MAXplus的包教包会
Platform: | Size: 2754373 | Author: 麦佳 | Hits:

[Other resource] fpgacompileII

Description: Fpga Compiler II + maxplus II 快速入门，相当不错，有了它，可以很快的进入到vhdl的世界。
Platform: | Size: 1895784 | Author: 达达幽 | Hits:

Description: 信道编码的实质是在信息码中增加一定数量的多余码元(称为监督码元)，使它们满足一定的约束关系，这样，由信息码元和监督码元共同组成一个由信道传输的码字。一旦传输过程中发生错误，则信息码元和监督码元间的约束关系被破坏。在接收端按照既定的规则校验这种约束关系，从而达到发现和纠正错误的目的。它在数字通信方面得到了广泛的应用。本文将简要介绍信道编码原理及其应用，并详细介绍本次设计所用到的（7，4）汉明码的编码译码原理、DPSK调制解调的原理并在MAXPLUS II上用VHDL语言实现。
Platform: | Size: 478528 | Author: 赵冉 | Hits:

[Develop Tools] logicdesigforFPGA

Description: 高级FPGA教学实验指导书－逻辑设计部分.pdf QuatusII5.0 是Altera 公司的最新产品。MaxplusII 是一套非常成功的PLD 开发软件，虽然QuartusII 已经推出了4 年，并且Altera 宣布不再对MaxplusII 进行升级，但至今仍有非常多的工程师在使用MaxplusII。 Altera 在QuartusII 中允许将软件界面设置为 MaxplusII 风格，以吸引MaxplusII 的用户转向QuartusII。安装QuartusII 时，软件会自动询问，你准备使用何种界面：QuartusII 还是Maxplus
Platform: | Size: 1091747 | Author: 董军 | Hits:

[Other resource] NO_2_ColorLight

Description: 这个是vhdl的彩灯实例程序，里面涵盖了48种的彩灯变化，通过了maxplus的验证，并且在机上实验通过-this is the Lantern example VHDL procedures inside covers 48 species of Carnival changes adopted maxplus certification, and the plane through experiments
Platform: | Size: 103718 | Author: 何蓥 | Hits:

[Other] 中断管理电路

Description: 用MAXPLUS制作计算机组成原理实验I/O中断管理电路的模拟。-Segments produced using Computer Engineering Experiment I / O circuit interruption management simulation.
Platform: | Size: 113329 | Author: 杨鼎新 | Hits:

[Other] 多路选择器

Description: 用maxplus2实现的简易多路选择器
Platform: | Size: 95200 | Author: lixm1988 | Hits:

[VHDL-FPGA-Verilog] 用VHDL编写的带报错和暂停控制功能的交通灯

Description: 现代数字系统作业在maxplus 10.0中调试通过
Platform: | Size: 245449 | Author: yanshiwo1@163.com | Hits:

[Program doc] CPLD实现快速低开关损耗的优化SVPWM算法

Description: 介绍了利用ALTERA公司的Maxplus Ⅱ软件及ACEX芯片,基于一种用于三相电压型逆变器的优化SVPWM算法,来实现变频调速系统,该算法采纳Kohonen神经网络的优点。选择适当的调制方法和改进的算法，不但可以显著地缩短计算时间,且显著减少开关损耗。用复杂可编程逻辑器件(CPLD) 来实现这种算法非常简单合适。
Platform: | Size: 98553 | Author: zt209@hotmail.com | Hits:

[VHDL-FPGA-Verilog] FIR低通滤波器部分模块

Description: 一个FIR低通滤波器,最小阻带衰减-30db,带内波动小于1db．用MAXPLUS2设计与仿真。-This is a FIR LPF, with-30dB in stop-band and sigma is less than 1dB. It is designed and simulated on MAXPLUS2.
Platform: | Size: 5120 | Author: 吴健宇 | Hits:

[Other] 中断管理电路

Description: 用MAXPLUS制作计算机组成原理实验I/O中断管理电路的模拟。-Segments produced using Computer Engineering Experiment I/O circuit interruption management simulation.
Platform: | Size: 112640 | Author: 杨鼎新 | Hits:

[Books] max+plus ii快速入门

Description: maxplus2是一款应用于硬件编程的编程软件，本文件教你快速掌握其编程，仿真方法。-maxplus2 hardware is a programming application programming software, this document will teach you grasp its programming and simulation methods.
Platform: | Size: 344064 | Author: 刘晓飞 | Hits:

[VHDL-FPGA-Verilog] shifter

Description: 用vhdl实现双向移位寄存器仿真环境MAXPLUS-II，QUARTUS--bidirectional use VHDL simulation environment shift register Segments-II, QUARTUS-
Platform: | Size: 149504 | Author: dm | Hits:

[VHDL-FPGA-Verilog] CNT_24

Description: 用vhdl实现24小时计数器，方法简单实用。仿真环境MAXPLUS--use VHDL to achieve 24-hour counter, simple and practical method. Simulation environment Segments-
Platform: | Size: 48128 | Author: dm | Hits:

[VHDL-FPGA-Verilog] pulse_change

Description: 用vhdl实现脉冲宽度可控的一简单程序仿真环境MAXPLUS--use VHDL to achieve controllable pulse width of a simple process simulation environment Segments-
Platform: | Size: 183296 | Author: dm | Hits:

[Other] wave0001

Description: 在MAX-PLUS下设计的函数消耗发生器，波形有正弦波、方波、三角拨、锯齿波（用键盘选择），信号频率可调（用键盘调节）-the MAX-PLUS design of the consumption function generator, a sine wave, square, triangle area and Sawtooth (keyboard), in signal frequency adjustable (keyboard conditioning)
Platform: | Size: 133120 | Author: 曹海学 | Hits:

[VHDL-FPGA-Verilog] 4x4的数据选择器

Description: 用vhdl的4x4的数据选择器，在maxplusII下编译、仿真通过。是构成大型数字电路的重要部件。适合vhdl初学者分析学习。-4x4 with the VHDL data selectors, under the maxplusII compiler, simulation through. Yes constitute large-scale digital circuits important components. VHDL Analysis for beginners to learn.
Platform: | Size: 3072 | Author: roya | Hits:

[VHDL-FPGA-Verilog] 8倍频vhdl

Description: 该文件可用vhdl语言实现时钟8倍频，运行环境可在maxplus2和ise的仿真软件上-the document available VHDL Language 8 clock frequency, the operating environment and ideally maxplus2 simulation software
Platform: | Size: 1024 | Author: 罗兵武 | Hits:

[VHDL-FPGA-Verilog] FIRvhdl

Description: 用vhdl实现一个fir滤波器设计要求： 1．最小阻带衰减-30db。 2．带内波动小于1db． 3．用MATLIB与MAXPLUS2联合设计与仿真-use VHDL to achieve a fir filter design requirements : 1. The smallest stop band attenuation- 30dB. 2. With fluctuating within less than 1DB. 3. With MATLIB with MAXPLUS2 joint design and simulation
Platform: | Size: 3072 | Author: 达闻西 | Hits:

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