用FPGA实现JPEG的Verilog源代码
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.............................\用FPGA实现JPEG的Verilog源代码
.............................\.............................\fpga-jpeg
.............................\.............................\.........\dct
.............................\.............................\.........\...\dct.v
.............................\.............................\.........\...\dctu.v
.............................\.............................\.........\...\dctub.v
.............................\.............................\.........\...\dct_bench
.............................\.............................\.........\...\.........\bench_top.v
.............................\.............................\.........\...\dct_cos_table.v
.............................\.............................\.........\...\dct_mac.v
.............................\.............................\.........\...\dct_syn.v
.............................\.............................\.........\...\fdct.v
.............................\.............................\.........\...\huffman
.............................\.............................\.........\...\.......\bench
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.............................\.............................\.........\...\.......\.....\generic_fifo_lfsr.v
.............................\.............................\.........\...\.......\.....\lfsr.v
.............................\.............................\.........\...\.......\.....\timescale.v
.............................\.............................\.........\...\.......\huffman_dec.v
.............................\.............................\.........\...\.......\huffman_enc.v
.............................\.............................\.........\...\.......\huffman_tables.v
.............................\.............................\.........\...\ro_cnt.v
.............................\.............................\.........\...\rtl_sim
.............................\.............................\.........\...\.......\Makefile.txt
.............................\.............................\.........\...\ud_cnt.v
.............................\.............................\.........\...\zigzag.v
.............................\.............................\.........\jpeg
.............................\.............................\.........\....\bench_top
.............................\.............................\.........\....\.........\jpeg_encoder.v
.............................\.............................\.........\....\jpeg_encoder.v
.............................\.............................\.........\....\sim
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.............................\.............................\.........\....\...\hdl.var
.............................\.............................\.........\....\...\Makefile.txt
.............................\.............................\.........\qnr
.............................\.............................\.........\...\attic
.............................\.............................\.........\...\.....\div.v
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.............................\.............................\.........\...\.....\ud_cnt.v
.............................\.............................\.........\...\bench
.............................\.............................\.........\...\.....\bench_div_top.v
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.............................\.............................\.........\...\d