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[Embeded-SCM Develop课题:计数式数字频率的CPLD实现.rar

Description: 本设计的基本要求是以复杂可编程逻辑器件CPLD为基础,通过在EDA系统软件ispDesignExpert System 环境下进行数字系统设计,熟练掌握该环境下的功能仿真,时间仿真,管脚锁定和芯片下载。 本系统基本上比较全面的模拟了计数式数字频率计,广泛应用于工业、民用等各个领域,具有一定的开发价值。
Platform: | Size: 439843 | Author: | Hits:

[Develop ToolsispDesignExpert

Description: 第 一 节 ispDesignEXPERT 简 介 第 二 节 ispDesignEXPERT System 的 原 理 图 输 入 第 三 节 设 计 的 编 译 与 仿 真 第 四 节 ABEL 语 言 和 原 理 图 混 合 输 入 第 五 节 ispDesignEXPERT System 中 VHDL 和Verilog 语 言 的 设 计 方 法 第 六 节 在 系 统 编 程 的 操 作 方 法 第 七 节 ModelSim 的 使 用 方 法 附 录 一 ispDesignEXPERT System 上 机 实 习 题 附 录 二 ispDesignEXPERT System 文 件 后 缀 及 其 含 义-Introduction Section II, section I ispDesignEXPERT ispDesignEXPE RT System III schematic design input to the compilation and simulation fourth ABEL language and schematics mixed input System V ispDesignEXPERT VHDL and Verilog language the statement in section VI Design System Programming methods of operation of the sect ModelSim use is an appendix pDesignEXPERT System attachment that the plane Appendix 2 ispDesignEXPE RT System file extension and its meaning
Platform: | Size: 1292134 | Author: 吴忌 | Hits:

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Description: 目 录 第 一 节ispDesignEXPERT 简 介 第 二 节ispDesignEXPERT System 的 原 理 图 输 入 第 三 节设 计 的 编 译 与 仿 真 第 四 节ABEL 语 言 和 原 理 图 混 合 输 入 第 五 节ispDesignEXPERT System 中 VHDL 和Verilog 语 言 的 设 计 方 法 第 六 节 在 系 统 编 程 的 操 作 方 法 第 七 节ModelSim 的 使 用 方 法 附 录 一ispDesignEXPERT System 上 机 实 习 题 附 录 二ispDesignEXPERT System 文 件 后 缀 及 其 含 义
Platform: | Size: 531749 | Author: 史蒙克 | Hits:

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Description: 频率计,vhdl语言, ispDesignEXPERT
Platform: | Size: 943 | Author: yuankui | Hits:

[Windows DevelopispDesignExpert

Description: ispDesignEXPERT 培训教程
Platform: | Size: 2389284 | Author: 小勇 | Hits:

[BooksispDesignExpert

Description: 第 一 节 ispDesignEXPERT 简 介 第 二 节 ispDesignEXPERT System 的 原 理 图 输 入 第 三 节 设 计 的 编 译 与 仿 真 第 四 节 ABEL 语 言 和 原 理 图 混 合 输 入 第 五 节 ispDesignEXPERT System 中 VHDL 和Verilog 语 言 的 设 计 方 法 第 六 节 在 系 统 编 程 的 操 作 方 法 第 七 节 ModelSim 的 使 用 方 法 附 录 一 ispDesignEXPERT System 上 机 实 习 题 附 录 二 ispDesignEXPERT System 文 件 后 缀 及 其 含 义-Introduction Section II, section I ispDesignEXPERT ispDesignEXPE RT System III schematic design input to the compilation and simulation fourth ABEL language and schematics mixed input System V ispDesignEXPERT VHDL and Verilog language the statement in section VI Design System Programming methods of operation of the sect ModelSim use is an appendix pDesignEXPERT System attachment that the plane Appendix 2 ispDesignEXPE RT System file extension and its meaning
Platform: | Size: 1292288 | Author: 吴忌 | Hits:

[OtherIn-systemProgrammableSolutions1

Description: 目 录 第 一 节ispDesignEXPERT 简 介 第 二 节ispDesignEXPERT System 的 原 理 图 输 入 第 三 节设 计 的 编 译 与 仿 真 第 四 节ABEL 语 言 和 原 理 图 混 合 输 入 第 五 节ispDesignEXPERT System 中 VHDL 和Verilog 语 言 的 设 计 方 法 第 六 节 在 系 统 编 程 的 操 作 方 法 第 七 节ModelSim 的 使 用 方 法 附 录 一ispDesignEXPERT System 上 机 实 习 题 附 录 二ispDesignEXPERT System 文 件 后 缀 及 其 含 义-Contents Section I Introduction Section II ispDesignEXPERT the ispDesignEXPERT System schematic design input Section III Section IV ABEL compiler and simulation language and schematic diagram in section V ispDesignEXPERT System hybrid input in VHDL and Verilog design language of section VI in the system programming method of operation to use the ModelSim section VII of Appendix 1 ispDesignEXPERT System-on internship title ispDesignEXPERT System Appendix II document and the meaning of the suffix
Platform: | Size: 531456 | Author: 史蒙克 | Hits:

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Description: 频率计,vhdl语言, ispDesignEXPERT-Frequency meter, vhdl language, ispDesignEXPERT
Platform: | Size: 1024 | Author: yuankui | Hits:

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Description: ispDesignEXPERT 培训教程-ispDesignEXPERT training course
Platform: | Size: 2388992 | Author: 小勇 | Hits:

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Description: 4.1 Altera MAX+plusⅡ操作指南 4.1.1 MAX+plusⅡ10.2的安装 4.1.2 MAX+plusⅡ开发系统设计入门 4.2 Xilinx ISE Series的使用 4.2.1 ISE的安装 4.2.2 ISE工程设计流程 4.2.3 VHDL设计操作指南 4.2.4 ISE综合使用实例 4.3 Lattice ispDesignEXPERT的使用 4.3.1 ispDesignEXPERT的安装 4.3.2 原理图输入方式设计操作 4.3.3 VHDL输入方式设计操作 -EDA
Platform: | Size: 1431552 | Author: lulu | Hits:

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