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Date : 2008-10-13 Size : 129.79kb User : 曹海学
[Other] VHDL-FPGA-clock DL : 0: ＦＰＧＡ数字钟的设计，用VHDL语言编程，max+plus仿真，可在实际电路中验证-FPGA design, VHDL programming, max plus simulation, in the actual circuit verification
Date : 2008-10-13 Size : 263.57kb User : 王越
[Other] MaxPlusII DL : 0: Designing with MAX+PLUS
Date : 2008-10-13 Size : 884.28kb User : 陈宏
[Other] f_add DL : 0: 本文件包是在MAX+plus II 软件环境下实现半加器的逻辑功能
Date : 2008-10-13 Size : 11.52kb User : 罗理平
[Other] h_adder DL : 0: 本文件包是在MAX+plus II 软件环境下实现全加器的逻辑功能
Date : 2008-10-13 Size : 12.88kb User : 罗理平
[Other] mendianlu DL : 0: 本文件包是在MAX+plus II 软件环境下验证门电路的逻辑功能
Date : 2008-10-13 Size : 12.17kb User : 罗理平
[Other] count DL : 0: 本文件包是在MAX+plus II 软件环境下实现计数器的逻辑功能
Date : 2008-10-13 Size : 56.97kb User : 罗理平
[Other] 1_061227123744 DL : 0: max plus的入门与应用，适合初学者对max plus ii有一个感性的认识
Date : 2008-10-13 Size : 231.58kb User : da
[Other] clock DL : 0: 本文介绍一种利用 EDA技术和VHDL 语言 ,在MAX+PLUSⅡ环境下,设计了一种新型的智能密码锁。它体积小、功耗低、价格便宜、安全可靠,维护和升级都十分方便,具有较好的应用前景
Date : 2008-10-13 Size : 66.29kb User : 叶仔
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Date : 2008-10-13 Size : 12.72mb User : twinslizzy