String with VHDL implementation and transformation procedures, FPGA test successfully, the correct transformation.

Para_to_Seril\db\Para_to_Seril.asm.qmsg
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.............\..\Para_to_Seril.cbx.xml
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.............\..\Para_to_Seril.cmp.rdb
.............\..\Para_to_Seril.cmp.tdb
.............\..\Para_to_Seril.cmp0.ddb
.............\..\Para_to_Seril.cmp2.ddb
.............\..\Para_to_Seril.cmp_bb.cdb
.............\..\Para_to_Seril.cmp_bb.hdb
.............\..\Para_to_Seril.cmp_bb.logdb
.............\..\Para_to_Seril.cmp_bb.rcf
.............\..\Para_to_Seril.dbp
.............\..\Para_to_Seril.db_info
.............\..\Para_to_Seril.eco.cdb
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.............\..\Para_to_Seril.hier_info
.............\..\Para_to_Seril.hif
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.............\..\Para_to_Seril.map.ecobp
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.............\..\Para_to_Seril.map_bb.cdb
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.............\..\Para_to_Seril.pss
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.............\Para_to_Seril.vhd
Para_to_Seril

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